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ATmega8515(L)

2512A–AVR–04/02

Figure 89. ExternalMemory Timing (SRWn1 = 0,SRWn0 = 0

Figure 90. ExternalMemory Timing (SRWn1 = 0,SRWn0 = 1)

ALE

T1 T2 T3

Write

Read

A15:8

AddressPrev. Addr.

DA7:0

Address DataPrev. Data XX

DA7:0 (XMBK = 0)

DataAddress

System Clock (CLK

CPU

)

8 12

ALE

T1 T2 T3

Write

Read

A15:8

AddressPrev. Addr.

DA7:0

Address

Data

Prev. Data XX

DA7:0 (XMBK = 0)

DataAddress

System Clock (CLK

CPU

)

8 12

1 2 ... 197 198 199 200 201 202 203 204 205 206 207 ... 222 223

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